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有关VGA图像显示
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一粒金砂（初级）, 积分 0, 距离下一级还需 5 积分
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我在做一个VGA图像显示的设计，然后采用的是定制ROM的方式。现在问题出在像素点的采集上，即定制ROM时那个.MIF或者.HEX文件里面的像素点怎么得到啊，希望知道的大侠们能指点指点···谢谢！
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五彩晶圆（高级）, 积分 9087, 距离下一级还需 913 积分
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有了解的可以解答一下:$
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呵呵，版主你用过不？
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用个字模提取软件，里面可以把图片进行转换的，自己再注意下时序就可以了。。:Q
A bad beginning makes a bad ending
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EDA实验报告-VGA彩条显示
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你可能喜欢vga_verilog VGA彩条显示，VGA图片 的程序。基于FPGA VHDL- -
238万源代码下载-
&文件名称: vga_verilog
& & & & &&]
&&所属分类:
&&开发工具: Others
&&文件大小: 19507 KB
&&上传时间:
&&下载次数: 119
&&提 供 者:
&详细说明：VGA彩条显示，VGA图片显示的程序。基于FPGA-vga color bar display and image display based on fpga
文件列表(点击判断是否您需要的文件，如果是垃圾请在下面评价投诉):
&&vga_verilog\VGA_bar\db\logic_util_heursitic.dat&&...........\.......\..\prev_cmp_VGA_bar.qmsg&&...........\.......\..\VGA_bar.amm.cdb&&...........\.......\..\VGA_bar.asm.qmsg&&...........\.......\..\VGA_bar.asm.rdb&&...........\.......\..\VGA_bar.asm_labs.ddb&&...........\.......\..\VGA_bar.cbx.xml&&...........\.......\..\VGA_bar.cmp.bpm&&...........\.......\..\VGA_bar.cmp.cdb&&...........\.......\..\VGA_bar.cmp.hdb&&...........\.......\..\VGA_bar.cmp.kpt&&...........\.......\..\VGA_bar.cmp.logdb&&...........\.......\..\VGA_bar.cmp.rdb&&...........\.......\..\VGA_bar.cmp0.ddb&&...........\.......\..\VGA_bar.cmp1.ddb&&...........\.......\..\VGA_bar.cmp2.ddb&&...........\.......\..\VGA_bar.cmp_merge.kpt&&...........\.......\..\VGA_bar.db_info&&...........\.......\..\VGA_bar.fit.qmsg&&...........\.......\..\VGA_bar.hier_info&&...........\.......\..\VGA_bar.hif&&...........\.......\..\VGA_bar.idb.cdb&&...........\.......\..\VGA_bar.lpc.html&&...........\.......\..\VGA_bar.lpc.rdb&&...........\.......\..\VGA_bar.lpc.txt&&...........\.......\..\VGA_bar.map.bpm&&...........\.......\..\VGA_bar.map.cdb&&...........\.......\..\VGA_bar.map.hdb&&...........\.......\..\VGA_bar.map.kpt&&...........\.......\..\VGA_bar.map.logdb&&...........\.......\..\VGA_bar.map.qmsg&&...........\.......\..\VGA_bar.map_bb.cdb&&...........\.......\..\VGA_bar.map_bb.hdb&&...........\.......\..\VGA_bar.map_bb.logdb&&...........\.......\..\VGA_bar.pre_map.cdb&&...........\.......\..\VGA_bar.pre_map.hdb&&...........\.......\..\VGA_bar.rtlv.hdb&&...........\.......\..\VGA_bar.rtlv_sg.cdb&&...........\.......\..\VGA_bar.rtlv_sg_swap.cdb&&...........\.......\..\VGA_bar.sgdiff.cdb&&...........\.......\..\VGA_bar.sgdiff.hdb&&...........\.......\..\VGA_bar.sld_design_entry.sci&&...........\.......\..\VGA_bar.sld_design_entry_dsc.sci&&...........\.......\..\VGA_bar.smart_action.txt&&...........\.......\..\VGA_bar.sta.qmsg&&...........\.......\..\VGA_bar.sta.rdb&&...........\.......\..\VGA_bar.sta_cmp.8_slow.tdb&&...........\.......\..\VGA_bar.syn_hier_info&&...........\.......\..\VGA_bar.tis_db_list.ddb&&...........\.......\..\VGA_bar.tmw_info&&...........\.......\greybox_tmp\cbx_args.txt&&...........\.......\incremental_db\compiled_partitions\VGA_bar.db_info&&...........\.......\..............\...................\VGA_bar.root_partition.cmp.cdb&&...........\.......\..............\...................\VGA_bar.root_partition.cmp.dfp&&...........\.......\..............\...................\VGA_bar.root_partition.cmp.hdb&&...........\.......\..............\...................\VGA_bar.root_partition.cmp.kpt&&...........\.......\..............\...................\VGA_bar.root_partition.cmp.logdb&&...........\.......\..............\...................\VGA_bar.root_partition.cmp.rcfdb&&...........\.......\..............\...................\VGA_bar.root_partition.map.cdb&&...........\.......\..............\...................\VGA_bar.root_partition.map.dpi&&...........\.......\..............\...................\VGA_bar.root_partition.map.hbdb.cdb&&...........\.......\..............\...................\VGA_bar.root_partition.map.hbdb.hb_info&&...........\.......\..............\...................\VGA_bar.root_partition.map.hbdb.hdb&&...........\.......\..............\...................\VGA_bar.root_partition.map.hbdb.sig&&...........\.......\..............\...................\VGA_bar.root_partition.map.hdb&&...........\.......\..............\...................\VGA_bar.root_partition.map.kpt&&...........\.......\..............\README&&...........\.......\VGA_bar.asm.rpt&&...........\.......\VGA_bar.bdf&&...........\.......\VGA_bar.cdf&&...........\.......\VGA_bar.done&&...........\.......\VGA_bar.fit.rpt&&...........\.......\VGA_bar.fit.smsg&&...........\.......\VGA_bar.fit.summary&&...........\.......\VGA_bar.flow.rpt&&...........\.......\VGA_bar.map.rpt&&...........\.......\VGA_bar.map.summary&&...........\.......\VGA_bar.pin&&...........\.......\VGA_bar.pof&&...........\.......\VGA_bar.qpf&&...........\.......\VGA_bar.qsf&&...........\.......\VGA_bar.sof&&...........\.......\VGA_bar.sta.rpt&&...........\.......\VGA_bar.sta.summary&&...........\.......\vga_ctrl.bsf&&...........\.......\vga_ctrl.v&&...........\.......\vga_ctrl.v.bak&&...........\.......\vga_pll.bsf&&...........\.......\vga_pll.ppf&&...........\.......\vga_pll.qip&&...........\.......\vga_pll.v&&...........\.......\vga_pll_bb.v&&...........\vga_ctrl\db\logic_util_heursitic.dat&&...........\........\..\prev_cmp_vga_ctrl.qmsg&&...........\........\..\vga_ctrl.amm.cdb&&...........\........\..\vga_ctrl.asm.qmsg&&...........\........\..\vga_ctrl.asm.rdb&&...........\........\..\vga_ctrl.cbx.xml&&...........\........\..\vga_ctrl.cmp.kpt&&...........\........\..\vga_ctrl.cmp.rdb
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&[] - vga彩色信号控制器设计：用VHDL语言编写程序，重点完成三个功能：
1.棋盘格图案显示：
用三基色原理在CRT显示器上显示由横竖八彩条重叠构成的棋盘格图案；
2.在显示器上依次显示0~9十个数字：
每个数字不同颜色，每个显示大约0.4秒，循环显示；
3.显示动画效果：
将静态图像以高频
&[] - 640*480 256 色 .BMP 文件显示程序，可以浏览、同时显示 4 幅图象，也可以 在屏幕上开一个窗口显示 .BMP 图象，并可以使用上下左右箭头键、PageUp/PageDown、Ctrl+Left、Ctrl+Right键浏览整幅图象，在S3、ATI等vga卡上 调试通过
&[] - 利用matlab读取灰度图数据并转换成raw，便于对raw用做DSP、单片机或者FPGA处理的源数据
&[] - FPGA vga彩条显示 vhdl编程语言
&[] - Verilog语言编写，能实现在vga上显示闪烁的俄罗斯方块，横竖彩条和棋盘格
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&[] - 用Verilog HDL编写的vga显示程序，可实现图像的显示，在DE2-70上测试通过，有很大的参考价值。
&[] - vga编程。实现3种模式的vga控制，分别产生横彩条，竖彩条，棋格彩条的显示
&[] - vga 使用vhdl语言实现一张图片的显示，具有完整的工程及源代码，下载验证通过（注意硬件差别）数字电路综合实验；报告；学校：北京邮电大学学院：信息与通信工程学院专业：；日；VGA图像显示控制器；一、摘要和关键词；摘要：VGA显示屏显示采用逐行扫描的方式解决，阴；的荧光屏上，产生GRB基色，合成一个彩色像素；关键词：行列扫描行列同步RGB三原色控制；二、设计任务要求；实验目的；1.熟练掌握VHDL语言和QuartusII软件；3.掌握利
数字电路综合实验
北京邮电大学
学院：信息与通信工程学院 专业：
学号： 班内序号：姓名：
VGA图像显示控制器
一、摘要和关键词
摘要：VGA显示屏显示采用逐行扫描的方式解决，阴极射线枪发出电子束打在涂有荧光粉
的荧光屏上，产生GRB基色，合成一个彩色像素。扫描从屏幕的左上方开始，从左到右，从上到下，逐行扫描，每扫完一行，电子束回到屏幕的左边下一行的起始位置，在这期间，CRT对电子束进行消隐，每行结束时，用行同步信号进行行同步；扫描完所有行，用场同步信号进行场同步，并使扫描回到屏幕的左上方，同时进行场消隐，并预备进行下一次的扫描。通过控制扫描计数器不同值时对RGB三原色信号的控制，来完成显示设计。
关键词：行列扫描
RGB三原色控制
二、设计任务要求
1. 熟练掌握 VHDL 语言和QuartusII 软件的使用； 2. 理解状态机的工作原理和设计方法；
3. 掌握利用 EDA 工具进行自顶向下的电子系统设计方法； 4. 熟悉 VGA 接口协议规范。 实验要求：
设计一个VGA 图像显示控制器，达到如下功能：
显示模式为640×480×60HZ 模式；
用拨码开关控制R、G、B（每个2 位），使显示器可以显示64种纯色；
在显示器上显示横向彩条信号（至少6 种颜色）；
在显示器上显示纵向彩条信号（至少8 种颜色）；
在显示器上显示自行设定的图形、图像等。
选做：自拟其它功能。
三、实验原理
1、显示控制原理
常见的彩色显示器一般由阴极射线管(CRT)构成，彩色由GRB( Red )基色组成。显示采用逐行扫描的方式解决，阴极射线枪发出电子束打在涂有荧光粉的荧光屏上，产生GRB基色，合成一个彩色像素。扫描从屏幕的左上方开始，从左到右，从上到下，逐行扫描，每扫完一行，电子束回到屏幕的左边下一行的起始位置，在这期间，CRT、对电子束进行消隐，每行结束时，用行同步信号进行行同步；扫描完所有行，用场同步信号进行场同步，并使扫描回到屏幕的左上方，同时进行场消隐，并预备进行下一次的扫描。VGA显示控制器控制 CRT显示图象的过程如图1所示
2、VGA时序信号
计算机内部以数字方式生成的显示图像信息，被显卡中的数字/模拟转换器转变为R、G、 B 三原色信号和行、场同步信号，信号通过电缆传输到显示设备中。对于模拟显示设备，如模拟CRT 显示器，信号被直接送到相应的处理电路，驱动控制显像管生成图像。设计 VGA 控制器的关键是产生符合VGA 接口协议规定的行同步和场同步信号，它们的时序关系如下图所示：
h_sync：水平同步信号（负脉冲），每个水平扫描周期显示器刷新一行； v_sync：垂直同步信号（负脉冲），每个垂直扫描周期显示器刷新一帧；
按照每秒60帧的刷新速度来计算，所需要的时钟频率为：
频率＝60Hz(帧数)×525(行)×800(每一行像素数)＝25.2MHz
所以我们通过开发系统的50MHz时钟资源，通过时钟分频产生25MHz的频率即可。虽然没有达到精确的25.2MHz的时钟频率(刷新率可能会是59Hz)，但是并不会造成影响。
3、VGA显示器的工作过程
以屏幕左上角的那个像素作为原点（1,1）。当显示器接收到控制器输出的v_sync信号，则开始一个新的垂直刷新循环，同时控制器输出h_sync信号。当经过P+Q=1.084ms的时间后，准备开始水平刷新循环，当h_sync信号的下降沿到来时，即开始刷新第一行（行数加1）。再经过B+C = 5.66?s的时间后，开始刷新第一行的第一个像素（列数加1），并按照所需的时钟频率，刷新此行中其余像素。直到显示器接收到下一个h_sync信号，又开始刷新第二行。
重复此过程，直到刷新到屏幕的底部。当刷新了最下面一行的最后一个像素后，显示器即完成了一帧的刷新，控制器又输出v_sync信号，显示器又开始一个新的垂直刷新循环。
四、系统设计（包括设计思路、总体框图、分块设计）
总体设计思路：
VGA显示器的控制器可划分为3个子模块： I.时钟分频子模块；
II.时序控制子模块 ，提供同步信号（h_sync和v_sync）及像素位置信息； III.生成图形子模块，接收像素位置信息，并输出颜色信息；
由于系统时钟为50MHZ，实验所需频率为25MHZ,故时钟分频模块只需在程序中通过分频语句完成；生成图形子模块由系统提供；所以重点设计的模块就是时序控制模块。
总体系统框图如下：
时序控制模块设计
行同步状态机状态转移图
列同步状态机状态转移图
时序控制模块流程图：
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