急急急，protel99se出现在DRC错误怎么办，是什么原因，新手求教，-电子产品世界论坛
急急急，protel99se出现在DRC错误怎么办，是什么原因，新手求教，
这是我的第一块电路板，求高手指教啊。
&第二张图中间部分是在生成PCB文件之后画上的直接加了一个网络地GND会不会有问题？第三个图是Design&option里面的设置，这个橘色是是DRC错误自己改成这色了，哪里不合适的请大家指导啊，
这是DRC检测里面的一部分错误，这个要怎么修改啊
&& Violation&&&&&&&& Net P14_0&& is broken into 4 sub-nets. Routed To 72.73%
&&&& Subnet : S13-2&&& S13-2&&& S13-2
&&&& Subnet : S14-2&&& S14-2&&& S14-2
&&&& Subnet : S15-2&&& S15-2&&& S15-2
&&&& Subnet : S16-2&&& S16-2&&& S16-2
&& Violation&&&&&&&& Net XT2OUT_0&& is broken into 3 sub-nets. Routed To 0.00%
&&&& Subnet : C3-2
&&&& Subnet : U2-52
&&&& Subnet : Y1-2
&& Violation&&&&&&&& Net XT2IN_0&& is broken into 3 sub-nets. Routed To 0.00%
&&&& Subnet : Y1-1
&&&& Subnet : U2-53
&&&& Subnet : C4-2
&& Violation&&&&&&&& Net XOUT_0&& is broken into 2 sub-nets. Routed To 0.00%
&&&& Subnet : Y2-1
&&&& Subnet : U2-9
&& Violation&&&&&&&& Net VREF+_0&& is broken into 2 sub-nets. Routed To 0.00%
&&&& Subnet : C10-2
&&&& Subnet : U2-7
&& Violation&&&&&&&& Net TMS_0&& is broken into 2 sub-nets. Routed To 0.00%
&&&& Subnet : U2-56
&&&& Subnet : JP1-5
&& Violation&&&&&&&& Net TDO_0&& is broken into 2 sub-nets. Routed To 0.00%
&&&& Subnet : U2-54
&&&& Subnet : JP1-1
&& Violation&&&&&&&& Net TDI_0&& is broken into 2 sub-nets. Routed To 0.00%
&&&& Subnet : U2-55
&&&& Subnet : JP1-3
&& Violation&&&&&&&& Net TCK_0&& is broken into 2 sub-nets. Routed To 0.00%
&&&& Subnet : U2-57
&&&& Subnet : JP1-7
&& Violation&&&&&&&& Net REST_0&& is broken into 5 sub-nets. Routed To 0.00%
&&&& Subnet : D1-1
&&&& Subnet : C1-2
&&&& Subnet : JP1-11
&&&& Subnet : R3-1
&&&& Subnet : U2-58
&& Violation&&&&&&&& Net P63_0&& is broken into 2 sub-nets. Routed To 0.00%
&&&& Subnet : J1-4
&&&& Subnet : U2-2
&& Violation&&&&&&&& Net P53_0&& is broken into 3 sub-nets. Routed To 0.00%
&&&& Subnet : R10-1
&&&& Subnet : U2-47
&&&& Subnet : U4-6
在Design Rule 里修改一下焊盘最小间距的规则就可以通过DRC ，不过在投板的时候要和PCB 板制造注明最小间距看看工艺是否能达到
嗯，我试试，但是我刚发现一个问题，在封装库里这个封装，紫色部分有重叠，是不是这个问题呢
重叠式不行的，你可以把管脚画的细长，但是不能太粗
嗯，明白了，
Protel Design System: Library Component Rule Check
PCB File : my430PCB
Date&&&& : 16-Dec-2014
Time&&&& : 08:49:02
Name&&&&&&&&&&&&&&& Warnings
------------------------------------------------------------------
SOT-223&&&&&&&&&&&&&&&&& Duplicate Pad Name On Pads Pad Free-2(2.29997mm,0.00001mm)& TopLayer And Pad Free-2(2.29997mm,6mm)& TopLayer
SW-PB-001&&&&&&&&&&&&&&& Duplicate Pad Name On Pads Pad Free-1(-6.25mm,-3.8mm)& TopLayer And Pad Free-1(6.25mm,-3.8mm)& TopLayer
SW-PB-001&&&&&&&&&&&&&&& Duplicate Pad Name On Pads Pad Free-1(0mm,0mm)& TopLayer And Pad Free-1(6.25mm,-3.8mm)& TopLayer
SW-PB-001&&&&&&&&&&&&&&& Duplicate Pad Name On Pads Pad Free-2(0mm,-11.176mm)& TopLayer And Pad Free-2(-3.048mm,-7.4mm)& TopLayer
SW-PB-001&&&&&&&&&&&&&&& Duplicate Pad Name On Pads Pad Free-2(3.1mm,-7.4mm)& TopLayer And Pad Free-2(-3.048mm,-7.4mm)& TopLayer
SW-PB-001&&&&&&&&&&&&&&& Duplicate Pad Name On Pads Pad Free-1(0mm,-3.8mm)& TopLayer And Pad Free-1(6.25mm,-3.8mm)& TopLayer
这是什么意思呀
在封装库里这个封装，紫色部分有重叠，
封装库还能重叠，这个肯定不行
这个都是重叠的，没有问题啊，或者说这个这样画对不对，如果不对应该怎么画啊
画这样的芯片封装，一般人的经验是，根据芯片手册提供的尺寸画，，没有捷径，，
当然可以修改所谓网上的封装库，这个捷径
楼上这样重叠是可以的，但是有这样的芯片管脚？怎么焊接，，没看懂
忘了写上了这个是按键
你好像是复制的，焊盘名字重复了
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