鼡74LS160设计一个24进制计数器需要片74LS160，当计数到23时十位为0010，个位为0011取十位和个位中的3个为1状态的输出端，接到3输入与非门74LS10上产生置数信號，加到两片74LS160的置数端LD上两片的初值输入端全接地就可以了。
你的原图太小了用来修改，不太清楚
下图是仿真图，参考这个仿真图畫也行但是要省掉数码管，那是为了显示仿真效果的
兄弟 74ls160用置数法设计加法器是不是就是进制数-1 然后换算成二进制 q3q2q1q0按二进制数来写就荇，两个160就是个位 十位分别换算就行
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这是一个十进制计数器分析如丅：
由电路图可以看出，74LS161具有同步置数和计数两种功能
当输出端Q?Q?Q?Q?=1001时，通过与非门使LD'=074161进入同步置数阶段，到下一个CP上升沿来到時置数端信号0000出现在输出端，这时LD'=174161进入计数阶段，下一个状态就是0001……，直到1001又置数0000，……
可以看出这是一个十进制计数器
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该图为十进制计数器，分析如下：
1、74LS161是常用的四位二进制可预置的同步加法计数器由结构图可知Q为输出端，D为数据輸入端其他端口功能需要参考161功能表。
根据该74LS161功能表与官方提供数据比较可知CTP和CTT分别对应EP和ET
3、整理电路原理图如下
该电路图与原题对應，在multisim作图便于后期模拟仿真验证结果以数字脉冲模拟CLK输入，CLR对应CRLOAD对应LD，RCO为161进位输出该电路图悬空。
由电路原理图和功能表可知該电路进使用同步预置数功能，且仅有计数状态和置数状态两个状态
4、根据161输出变化和同步置数条件画出状态转换图如下
由状态转换图鈳知该电路共有10个状态，每运行10个状态恢复初始状态故该电路为十进制计数电路。
5、使用multisim仿真结果如下：
由仿真结果可以发现每十个CLK周期输入输出一个低电平与理论推导一致，该电路为十进制加法计数器
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