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设计一个如图3.1.32所示的组合逻辑电蕗它有四个输入端A1、A0、B1、B0(A1A0和B1B0均表示两位二进制数)和一个输出端Y,电路的功能为:当变量A1、A0的逻辑与非()和变量B1、B0的逻辑异或()相等时函数Y=1,否则为0
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设计一个如图3.1.32所示的组合逻辑电蕗它有四个输入端A1、A0、B1、B0(A1A0和B1B0均表示两位二进制数)和一个输出端Y,电路的功能为:当变量A1、A0的逻辑与非()和变量B1、B0的逻辑异或()相等时函数Y=1,否则为0
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