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FPGA后仿真流程..doc 21页
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FPGA后仿真流程.
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XilinxFPGA仿真流程版本：1.0（本流程是基于设计代码已完成）电路设计的各个阶段都与仿真紧密联系在一起的，可以分为以下几个阶段的仿真：行为级：用于验证电路框架及算法的正确性；RTL级（寄存器传输级）：可以验证功能正确性，一般称为前仿真；门级：综合出门级网表之后，网表中加入了门的延时信息，仿真结果更接近于真实情况；后仿真：布局布线后，可以将连线延时加入到网表中，此时可以验证电路的时序是否正确；实际上我们在编写设计代码时，一般从是RTL级开始。RTL级仿真通过，然后直接进入后仿真。只要后仿真通过了，我们就认为设计代码通过验证，可以下载到FPGA里。所以我们需要仿真的只有RTL级和后仿真就行了！一．RTL级仿真步骤：1．打开ModelSim，新建一个project，如图1.1图1.1得到CreataProject的弹出窗口，如图1.2所示。在ProjectName栏中填写你的项目名字。ProjectLocation是你的工作目录，你可通过Brose按钮来选择或改变。DdfaultLibraryName可以采用工具默认的work库。（推存，此库包括一个特殊的文件_info）图1.22．给工程加入文件：ModelSim会自动弹出AddItemstotheproject窗口，如图1.3所示。选择AddExsitingFile后，根据相应提示将文件加到该Project中。图1.3出现图1.4图1.4点击Browse，出现添加你所要的.v文件，出现。当然也可以这样添加你所要的.v文件，3．编译：编译（包括源代码和库文件的编译）。编译可点击ComlileComlileAll来完成。也可以这样编译文件编译成功后，所有的文件后会打勾。装载文件：如图2.5所示，出现，选中你的test文件，点击OK6．开始仿真，添加波形图点击runall出现波形二．后仿真步骤：1．启动ISE的ProjectNavigator，然后新建一个project。点击File-&NewProject，出现然后选择器件和综合工具，注意选择适当的GeneratedSimulationLanguage点击下一步，直到完成2．添加文件3．开始综合4．综合通过后，准备生成布局布线后的SDF文件再运行ModelSim之前，首先把glbl.v文件（网表文件）复制到的ISE工程所在文件夹里，和你的代码放在一起。glbl.v文件所在路径为：复制到运行ModelSim，加入相应的后仿真库，有以下3个：Unisim：仅仅用来做功能仿真，在这个库中包括了Xilinx公司全部的标准元件，可以被绝大多数综合工具推论。XilinxCoreLib：仅仅用来做功能仿真，在这个库中包括了使用XilinxCoreGenerator工具产生的IP仿真模型。Simprims：用来做时序仿真或门级功能仿真。仿真 Unisim XilinxCoreLib Simprims
综合后功能 Y Y
映射后时序
布局布线后时序
如何在ModelSim里添加以上3个库在File-&ChangDirectory路径为/Modeltech_6.0/verilog_src新建一个Libary输入LibraryName选中Unisim,然后Compile找到\Xilinx\verilog\src\unisims，Compile所有unisims库里的文件。文件太多，建议分几次编译同样的方法编译XilinxCoreLib和Simprim新建一个Project，和ISE的工程存放在一起添加glbl.v（网表文件）,*_timesim.v（sdf时序约束文件）和你的test.v（测试文件）文件编译后，启动Simulate.在Libaries下，添加Simprim库在SDF下，添加SDF文件注意ApplytoRegion,为你的test文件包含你的功能文件的路径接下来在Design-&work下，同时选中glbl和test文件，点击OK10．于RTL级仿真一样，开始仿真，添加波形图
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贴数:21&分页:jumper发信人: windmark (jumper), 信区: FPGATech
标&&题: Re: 问一下FPGA和ASIC在设计流程上的区别是什么？
发信站: 水木社区 (Thu Oct 25 10:51:00 2012), 站内 && 设计绝大部分是在linux服务器下使用脚本搞的
google一下吧，介绍很多的
【 在 xdlaoliu (小六) 的大作中提到: 】
: 能说一下ASIC设计大概的流程和流程中需要用到的工具吗？一楼说需要用到linux和tcl或者perl语言是怎么回事？
&&&& -- && ※ 来源:·水木社区 newsmth.net·[FROM: 203.86.34.*]
小六发信人: xdlaoliu (小六), 信区: FPGATech
标&&题: Re: 问一下FPGA和ASIC在设计流程上的区别是什么？
发信站: 水木社区 (Thu Oct 25 16:01:07 2012), 站内 &&&& 【 在 tongfuli 的大作中提到: 】
: 这个问题太基础了，不好回答，你先上网搜索学习一下好了
哈哈 是我没做过ASIC的，所以脑子里一片空白，只是好奇，然后为找工作做准备吧。
-- && ※ 来源:·水木社区 ·[FROM: 114.255.41.*]
小白发信人: BLC (小白), 信区: FPGATech
标&&题: Re: 问一下FPGA和ASIC在设计流程上的区别是什么？
发信站: 水木社区 (Thu Oct 25 22:24:02 2012), 站内 && 主要还是asic的开发的一次性投入大
对设计各个流程的验证工作投入很多 && 如果一次流片降到10万rmb以内，估计验证就会弱化很多
【 在 xdlaoliu (小六) 的大作中提到: 】
: 那请问ASIC的开发难度比FPGA大体现在哪方面呢？
&&&& -- && ※ 来源:·水木社区 newsmth.net·[FROM: 123.118.105.*]
小白发信人: BLC (小白), 信区: FPGATech
标&&题: Re: 问一下FPGA和ASIC在设计流程上的区别是什么？
发信站: 水木社区 (Thu Oct 25 22:25:30 2012), 站内 && ic工具大部分在linux下，以前大部分在solaris上.... && 【 在 xdlaoliu (小六) 的大作中提到: 】
: 能说一下ASIC设计大概的流程和流程中需要用到的工具吗？一楼说需要用到linux和tcl或者perl语言是怎么回事？
&&&& -- && ※ 来源:·水木社区 newsmth.net·[FROM: 123.118.105.*]
I love this game发信人: kissyyyyyyyy (I love this game), 信区: FPGATech
标&&题: Re: 问一下FPGA和ASIC在设计流程上的区别是什么？
发信站: 水木社区 (Thu Oct 25 23:23:07 2012), 站内 && 其实我觉得这两个虽然有交集,但是从业人员的侧重点有很大不同,可能asic的更细节, fpga的更广度.
具体点是asic的分工更细, fpga的面更广
【 在 xdlaoliu 的大作中提到: 】
: 我先说一下我自己的理解，FPGA是通用芯片，主要厂家就是Xilinx和Altera。是可以让开发人员通过编写程序修改电路的。ASIC是专用芯片，我们电脑里和手机里的CPU都是ASIC芯片。ASIC芯片的功能是厂家生产出来以后就固定的。不能让开发人员修改。不知道这种看法对不对？
:&&&& FPGA和ASIC开发都需要进行前仿真（布局布线前的仿真）和后仿真（布局布线后的仿真）但是区别在哪里呢？是不是ASIC的布局布线过程要手动进行更加复杂呢？ASIC的前端开发都是用FPGA进行仿真的吗？流片呢？FPGA可以流片吗？还是只有ASIC可以流片？
&& -- && ※ 来源:·水木社区 ·[FROM: 114.248.206.*]
garfield发信人: frankrick (garfield), 信区: FPGATech
标&&题: Re: 问一下FPGA和ASIC在设计流程上的区别是什么？
发信站: 水木社区 (Fri Oct 26 07:02:37 2012), 站内 && ASIC设计里面有很多是FPGA应用设计无需考虑的，例如可测试性设计（包括FF scan chain、BIST、test pattern等等）、时钟树平衡、模块级门控时钟...... && 你可以把FPGA器件想象是已经设计制造完毕的ASIC，因此FPGA应用设计只需要在此基础上进行“硬件编程”，需要操心担忧的事情少了很多 &&&& 【 在 xdlaoliu (小六) 的大作中提到: 】
: 哈哈 是我没做过ASIC的，所以脑子里一片空白，只是好奇，然后为找工作做准备吧。
&& -- && ※ 来源:·水木社区 ·[FROM: 65.119.96.*]
8d发信人: m8d (m8d), 信区: FPGATech
标&&题: Re: 问一下FPGA和ASIC在设计流程上的区别是什么？
发信站: 水木社区 (Fri Oct 26 09:22:44 2012), 站内 && 没有什么太大不同
基本上能做fpga的也能做asic，反之亦然
要考虑的东西都差不多，就是timing，power，dft，外围电路接口等等
不过FPGA有些东西厂家可能帮你做了一部分(比如DFT). && 唯一不同的是做ASIC的，偶尔也有机会玩玩FPGA，主要用来验证ASIC &&&& 【 在 xdlaoliu (小六) 的大作中提到: 】
:&&&& 我先说一下我自己的理解，FPGA是通用芯片，主要厂家就是Xilinx和Altera。是可以让开发人员通过编写程序修改电路的。ASIC是专用芯片，我们电脑里和手机里的CPU都是ASIC芯片。ASIC芯片的功能是厂家生产出来以后就固定的。不能让开发人员修改。不知道这种看法对不对？
:&&&& FPGA和ASIC开发都需要进行前仿真（布局布线前的仿真）和后仿真（布局布线后的仿真）但是区别在哪里呢？是不是ASIC的布局布线过程要手动进行更加复杂呢？ASIC的前端开发都是用FPGA进行仿真的吗？流片呢？FPGA可以流片吗？还是只有ASIC可以流片？
&&&& -- && ※ 来源:·水木社区 newsmth.net·[FROM: 69.138.73.*]
小六发信人: xdlaoliu (小六), 信区: FPGATech
标&&题: Re: 问一下FPGA和ASIC在设计流程上的区别是什么？
发信站: 水木社区 (Fri Oct 26 10:43:47 2012), 站内 &&&& 【 在 BLC 的大作中提到: 】
: ic工具大部分在linux下，以前大部分在solaris上....
所以要开发人员熟悉LINUX操作系统和tcl脚本语言喽？
-- && ※ 来源:·水木社区 ·[FROM: 114.255.41.*]
garfield发信人: frankrick (garfield), 信区: FPGATech
标&&题: Re: 问一下FPGA和ASIC在设计流程上的区别是什么？
发信站: 水木社区 (Fri Oct 26 12:25:55 2012), 站内 &&&& 【 在 m8d (m8d) 的大作中提到: 】
: 没有什么太大不同
: 基本上能做fpga的也能做asic，反之亦然
: 要考虑的东西都差不多，就是timing，power，dft，外围电路接口等等
: 不过FPGA有些东西厂家可能帮你做了一部分(比如DFT).
&& 不是厂家可能帮，而是人家已经实现了DFT和时钟树——交给客户的是经过功能和老化测试的芯片 && -- && ※ 来源:·水木社区 ·[FROM: 65.119.96.*]
dearpd发信人: dearpd (dearpd), 信区: FPGATech
标&&题: Re: 问一下FPGA和ASIC在设计流程上的区别是什么？
发信站: 水木社区 (Mon Nov&&5 09:20:20 2012), 站内 && 算法设计-》算法仿真-》RTL编码-》FPGA验证-》综合（常用工具DC）-》后端布局布线DFT等-》（常用工具：ICC、Astro、Virtuoso）-》DRC、LVS、静态时序分析、后仿（Calibre、PrimeTime、VCS等等）。 && 【 在 xdlaoliu 的大作中提到: 】
: 能说一下ASIC设计大概的流程和流程中需要用到的工具吗？一楼说需要用到linux和tcl或者perl语言是怎么回事？
&& -- && ※ 来源:·水木社区 ·[FROM: 220.181.118.*]
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