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基于ZedBoard和linux的应用程序HelloWorld的实现（完整工程）获取Zedboard可运行的linux Digilent官网给出Zedboard的可运行linux设计ZedBoard_OOB_Design包，可从/Data/Documents/Other/ZedBoard_OOB_Design.zip获取，下载后解压，可以看到包...
　　这一节的目的是使用XPS为ARM PS 处理系统 添加额外的IP。从IP Catalog 标签添加GPIO，并与ZedBoard板子上的8个LED灯相连。当系统建立完后，产生bitstream，并对外设进行测试。本资料为源代码，原文设计过程详见：【 玩转赛灵思Zedboard开发板（4）：如何使用自带外设IP让ARM PS访问FPGA？】 　　硬件平台：Digilent ZedBoard...
zedboard\\\\ds187-XC7Z010-XC7Z020-Data-Sheet.pdf
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如图：小弟我用zedboard的PL端接收CMOS的图像数据，然后存RAM减速，在通过AXI给PS，SDK接收的的图像如图，真心不知道问什么，求各位大神相助
MT9P031图像条纹，求助，急！ “为什么”不是“问什么”，打错了。。。 原图案是什么？这个像是软件处理流程有问题。 [quote][size=2][url=forum.php?mod=redirect&goto...
求大神帮助：zedboard用USB和PC通信应该怎么玩？驱动要用什么类型？有没有什么帮助文档之类的？
zedboard用USB和PC通信 zedboard板载USB需要安装驱动，具体要看你的操作系统版本。建议楼主去看看zedboard的使用手册，zedboard官网上有，不少国内网站也有，本站是否有不清楚，可以去下载栏目搜一下。 谢谢回答，我去找找，:handshake...
德致伦zybo7010开发板出售zynq7010开发板，转让价格950，提供学习阶段技术支持 950
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【黑金ZYNQ7000系列原创视频教程】20.Linux下的GPIO操作
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大家交流，感觉资源不用介绍了，就是两个子牛逼！ADC 150M 、DAC 250M全是双通道。也许大家有更牛逼的但是，作为学生的我还是认为很不错啦，别喷我哈哈！
altera几个HSMC我收藏的好板卡都是好的都分享，兄弟们有什么想法呢？
最后就一个TQ2440和zedboard和MAX10哈哈都是能完成好作品的工具。哈哈分享给大家看看把 。有想法私信我哈哈。。。。。
=findpost&pid=2058697&ptid=498138][color=#999999]昱枫 发表于
14:53[/color][/url][/size]
tiny 6410 多少[/quote]
freescale是什么板子 zedboard多钱 [quote][size=2][url=forum.php?mod=redirect&goto...
=496764][color=#5 发表于
05:50[/color][/url][/size]
cat3902982, Thank you.
里面都是好用的FMC母板。
为了方便大家好看。拉了个 ZC706 上来了。[/quote]
其实zedboard就可以了，而且zedboard支持好多板子！...
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使用Xilinx公司的Spartan-6 FPGA作DDR芯片测试
　　目前广泛使用的计算机内存芯片是(双倍数据率同步动态随机存储器)[1]。它的最新品种3单片容量已经可以达到2Gb以上，数据率可以达到1.6Gb/s以上[2]，因此如何快速准确判定芯片的好坏(功能测试)就很必要。本文引用地址：
　　由于DDR这类芯片的设置和读写时序相当复杂，要在其性能所达到的高速条件下对其进行测试，许多人选用的技术方法是：直接把它们放到计算机的内存专用插座上，编一个相应的程序去进行测试。这不失为一种最简单的选择。但由于在测试过程中，计算机读取相应的指令还要花费不少时间，所以在芯片容量越来越大的情况下，这并不是一个好方法。
　　使用，将测试软件变成硬件，做成DDR专用测试工具，是提高测试效率的较好的选择。一开始设计的DDR专用测试工具是使用公司的Spartan-3E来实现的，但是很快发现：无论如何进行设计约束，诸多的地址信号、控制信号和数据信号很难做到同步送出，信号时延的离散范围很难达到0.2ns以下。对于数据率在200Mb/s以下的早期DDR产品，这勉强可以接受。但目前DDR2的数据率已经可以高达800Mb/s，也就是说，按相位角算，离散范围已达60&。为了保证上述有关信号的同步，不得不在与DDR相连接的所有信号线之间，增加了用CPLD器件做成的同步接口，利用CPLD器件端口到端口具有一致的延时特性来保证所有信号时间上的一致性。
　　对于公司的Spartan-6系列[3]，由于它有专为各类DDR内存设计的存储器控制模块(MCB)，用户可以利用提供的存储器控制模块，直接驱动DDR芯片，大大方便了与DDR的接口。
　　在我们新的DDR专用测试工具&DDR存储芯片测试仪&中，使用Spartan-6系列的XC6SLX16芯片，按照该公司的ug416.pdf文件[4]的指引，用CORE Generator软件中的MIG3.4分别产生了DDR2和DDR3两种类型的应用文件，包括DDR的基层MCB控制模块的应用文件，和它们的高层次使用举例文件example_top。后者本身就是一个DDR的测试程序，它向你显示如何实现与基层MCB控制模块接口。我们在它的基础上增加了一些测试模式，并增加了测试设置寄存器和测试结果状态寄存器，用一个宏晶公司的STC12C5408单片机作为整个DDR芯片测试设备的管理器，经串行口与主机通信，很顺利地实现了对DDR2、DDR3芯片的测试。
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我来说两句……
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微信公众号二
微信公众号一针对基于Xilinx Spartan 3E FPGA设计的Spartan 3E-1600开发板
该针对基于 Spartan 3E 设计，提供了一个强大、先进的独立开发平台。其最大特色是集成了一个160万门Spartan 3E FPGA，能够实现包括32位MicroBlaze RISC软处理器与DDR接口在内的大型复杂数字系统。 这块开发板的另一大特点是能通过板上USB2.0接口或者外设的并口、USB下载线进行JTAG编程。该FPGA通过板上Xilinx Platform Flash，Inter StrataFlash，ST Microelectonics Serial Flash和许多其他选项来提供配置。 它能与所有版本的Xilinx ISE工具相兼容，其中也包括免费的WebPack版本。套件中会附带一个用于编程的电源和USB下载线，那么您就可以马上进行设计实现而不需要支付其他 费用。该Spartan 3E-1600开发板同样也兼容于Xilinx EDK（Embedded Development Kit）特色的32位MicroBlaze RISC处理器。PicoBlaze软处理器内核也可通过ISE来操作。
Xilinx XC3S1600E FPGA
Xilinx XCF04 Platform Flash用于存储FPGA配置
ST Microelectronics公司的M25P16 16Mbit Serial Flash
Intel公司的TE28F128（或者JS28F128）128Mbit StartaFlash
Linear Technology公司的供电系统
Texas Instruments公司的TPS75003三路高效率功率管理IC
SMSC公司LAN83C185以太网物理层传输芯片
Micron公司的256Mbit DDR SDRAM
电路相关文件(请在PC端查看下载)
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将彩色图像转化为灰度的方法有两种，一个是令RGB三个分量的数值相等，输出后便可以得到灰度图像，另一种是转化为YCbCr格式，将Y分量提取出来，YCbCr格式中的Y分量表示的是图像的亮度和浓度所以只输出Y分量，得到的图像就是灰度图像了。我在这里选择第二种方法实现。使用Xilinx zynq开发板。YCBCr是通过有序的三元组来表示的，三元由Y（Luminance）、Cb（Chrominance-Blue）和Cr（Chrominance-Red）组成，其中Y表示颜色的明亮度和浓度，而Cb和Cr则分别表示颜色的蓝色浓度偏移量和红色浓度偏移量。人的肉眼对由YCbCr色彩空间编码的视频中的Y分量更敏感，而Cb和Cr的微小变化不会引起视觉上的不同，根据该原理，通过对Cb和Cr进行子采样来减小图像的数据量，使得图像对存储需求和传输带宽的要求大大降低，从而达到在完成图像压缩的同时也保证了视觉上几乎没有损失的效果，进而使得图像的传输速度更快，存储更加方便。我们要的到灰度图像，首先要将采集到的彩色图像转化为YCbCr。
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本设计介绍的是2015年全国大学生电子设计竞赛F题数字频率计，见附件下载其数字频率计源码/参考资料等。该数字频率计源码程序主要分为FPGA和STM32两部分。FPGA部分：实现了对输入信号的频率，占空比，时间间隔的测量并且通过串口发送到stm32f103单片机上进行处理及显示；单片机部分：主要实现与FPGA通信，通过串口将测量到的频率、时间间隔、占空比数据进行处理并用3.5寸电阻TFT彩屏显示出来。说明：
单片机型号：STM32F103ZET6
编译环境：keil 5FPGA型号：EP4CE6E22C8， 编译环境 quartus ii 15.0
淘宝恒创科技买的158元,便可以直接连接不用重新配置管脚附件资料截图：
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本项目只做了FPGA向STM32发送数据，属于单向通信，另外，为了产生数据发送到STM32，FPGA程序中写了一个计数器，实际工程中根据自己的需求删除即可，FPGA中的SPI模块中有完整的发送接收程序，因为本次不需要FPGA接收数据，所以接收部分写出来了，但未例化到顶层文件。使用平台：FPGA板+STM32板（我使用的是正点原子战舰板，根据自己的STM32板子，修改TFT驱动程序，SPI使用的是SPI2，可自行修改）连接方式：查看目录下 IO分配.txt附件资料截图：
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该设计其实是一款经典打砖块游戏（小球反弹游戏），其中有涉及到有关小球滚动方面的设计，希望能给2017年全国电子大赛的朋友参考。该小球反弹游戏控制系统由主控逻辑、运动控制、VGA、Transfer、Brick等模块以及多个Rom存储模块组成。小球运动控制模块接受主控模块提供的小球位置信息，判断小球是否与上、左、右壁发生碰撞，或者与下面的挡板发生碰撞。综合从Brick模块传入的碰撞信息，使得dx,dy中的一个或者两个反向(与挡板的非镜面反射除外)，实现了球的反弹。在小球没有碰撞到任何物体时，小球按照一定的步频与步幅进行运动，步频与步幅可以进行调节，保证了小球运动方向与速度的可变性。具体有关FPAG控制小球运动介绍，详见附件内容设计说明。FPGA控制小球运动及VGA显示系统设计框图：本设计由3人合作完成，用VHDL语言实现，内含实验报告和源代码。 游戏特点有： 不同难度级别、 计分功能、 生命值、 绚丽结束画面、 砖块形转方便修改、 随机发射速度、 挡板不同位置反射角不同、 小球速度、挡板宽度可变 通过FPGA实验板和VGA测试。FPGA控制小球运动及VGA显示源码截图：
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该设计资料分享的是某工程师打造的基于EP1C3T144 FPGA 系统板电路原理图和PCB工程文件，该EP1C3T144 FPGA 系统板具有详细的功能区域划分，主要由11个重要功能模块组成，如下：电源滤波、JTAG配置电路、AS配置电路、晶拨码电路、LED电路、滤波电容、用户扩展接口、按键电路、SRAM电路、EP1C3T144FPGA 芯片。这一块实验板用的 EP1C3T144 的芯片，有3000LE 逻辑资源，另外还有13 条M4K RAM （共6.5Kbyte），另外还有还有一个数字锁相环。这些资源能够足够应付电子设计竞赛和日 常教学的需要，也可以作为初学者入门学习fpga 的工具。EP1C3T144 FPGA 系统板原理图截图：EP1C3T144 FPGA 系统板PCB截图：
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声明：该设计来自阿莫论坛，设计资料仅供学习参考，不可用于商业用途。这个版本的PCB是根据一款市售的通用壳体设计的，也就是有“外壳”，如果能用阿莫的机器给开孔那就解决了很多网友（包括我）头疼的外壳问题！本来这个版本的示波器是使用PSP的液晶屏，试验下来发现功耗要比现在所使用的这款3.5寸的大，其实这个屏的分辨率要略高于PSP的480*272，现实更加细腻，只是没有4.3寸的屏看起来爽。FPGA双通示波器作品实物图展示：FPGA双通示波器性能参数：
通道数：2通道模拟带宽：30MHz采样率：双通道，每125Msps垂直精度：8bit存储深度：每通道不小于8KB电压灵敏度：10mv/div~5v/div（1:1探头）扫速范围：100ns/div~5s/divFFT功能：1024点FFTX-Y功能触发方式：单次、正常、自动，触发电压可调并带有超前触发功能480*320/3.5寸高分辨率液晶显示器。工作电压：6.2V~9V，推荐使用8V稳压电源最大电流消耗：350mA（8V），因为数字部分使用DC/DC稳压电路，所以电流消耗与供电电压有一定关系。
按键功能：
s0:模式选择（选择示波器和FFT）s1:通道选择（分别为：通道1,通道2,双通道和X-Y模式即李莎育图）s2:触发方式选择（分别为：自动上升沿，自动下降沿，正常上升沿，正常下降沿）s3:触发通道选择（触发通道在单通道时默认为当前通道，不能选择，只有在双通道和X-Y模式下可选）s4:存储深度选择（分别为：1000点，2000点，4000点，8000点每通道选择）注：在低扫速下使用地存储深度可以获得较好的实时性s5:输入耦合选择（分别为交流耦合AC和直流耦合DC两种方式）s6:上下键功能选择（设置上下键的功能，分别为灵敏度ATT、基线位置Level、触发电平TrigY） 注：s12和s10为1通道的上下键，s13和s11为2通道的上下键s7:左右键功能选择（设置左右键的功能，分别为扫速控制Speed和触发水平位置设置TrigX）注：s14和s15为左右键s8:单次触发（单次触发功能，只有触发模式为正常情况下可以用，自动模式下不可用）s9:运行停止键
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其实很多网友一直在纳闷，甚至都有网友直接问我，你搞这个 iCore 有啥用啊，这样的问题其实很难回答，因为任何东西都有他的应用限制，想做成万能的东西根本是不可能的，这个帖子我会吹一下这个东西的优势，但是不会说他是万能的。icore系列核心板一共发布了三代，现在90%的客户是做一些行业内小批量的应用，有用它做数据采集的，有做运动控制的，有做工控核心的，有做人机界面的。。。。。CPU + FPGA双核心的优势在于，CPU 的指令是串行执行的，而FPGA索性可以看做一个 “并行” 处理器，就好比 CPU 是一个公司的总经理，而 FPGA 可以看做是诸多秘书、部长、等组成的专业团队；什么事情都让总经理处理一是会影响效率；二是在要紧关头处理不过来会耽误事。用 CPU + FPGA 这种思想就好多了， 总经理（CPU）把握好一些关键的事情，并把任务一一分配给手下（FPGA内逻辑并行单元），让他们各自分管一摊；这样安全可靠、响应迅速、效率高。下面我就贴一个网友用 iCore3双核心板做的工控设备：/v_show/id_XMTcxNzc5MDQwOA==.htm.../v_show/id_XMTcxNzc4ODQ5Ng==.htm... 附件内容截图：
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性能目标主控: EP2C8Q208（NIOS软核） 液晶屏: 3.2"TFT320×240 65K彩色LCD显示屏 AD: AD9288双通道200Msps+200Msps 模拟带宽 & 20MHz 取样率8Bits 基本硬件： DAC7612 +opa657+AD8138+AD8370+AD9288+EP2C8Q208 垂直灵敏度：5V，1V，500mV,200mV,100mV,50mV; 基准电压使用12bit DA输出，实现按键调节波形基准。 水平时基范围：500mS,200mS,100mS,50mS,20mS,10mS,5mS,2mS,1mS,500uS,200uS,100uS,50uS,20uS,10uS,5uS,2uS,1uS,500nS, 250nS,125nS, 25nS,触发电平高低位置可调，并电压指示 可前后触发。 输入阻抗：≥1MΩ 探头档位： X10 档 最高输入电压：50Vpp 耦合方式：AC/DC实现自动、常规、单次触发方式 ,上升或下降边沿触发 选择测量输入信号的最大值，最小值，交流峰-峰值、平均值，周期、频率、正脉宽、负脉宽 实现5个内部波形存储，掉电无丢失。 当前测试设置内部存储，掉电无丢失。实现RUN/STOP功能 STOP状态下，波形浏览功能。电源使用二节2500mA锂电，正常工作5小时以上。测试图片：CH2-50KCH1-100KCH1 -5KCH1-13.5M-25nSCH1-13.5M-125nS操作界面:STOP状态:测量设置:内部存储:触发设置:
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