带同步置0,异步置1端的下降沿JKvhdl rs触发器器,VHDL

&&&&带有异步置位复位端的上升沿触发的JK触发器带波形图
带有异步置位复位端的上升沿触发的JK触发器带波形图
修改了以前网络上错误的vhdl代码,带有异步置位复位端的上升沿触发的JK触发器并附带仿真波形图
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一、概述:
1、触发器的基本要求:
(1)应该具有两个稳定状态,0状态和1状态。
(2)能够接收、保存和输出信号。
2、触发器的现态和次态
现态:触发器接收输入信号之前的状态,用Qn表示。
次态:触发器接收输入信号之后的状态,用Qn+1表示。
3、触发器的分类:
(1)基本触发器:基本RS触发器,输入信号直接加在输入端的,是最基本的触发器结构。
(2)同步触发器:包括同步RS触发器和同步D触发器,输入信号是通过控制门输入的,管理控制门的是时钟脉冲的CP信号。
(3)边沿触发器:包括边沿D触发器、边沿JK触发器、T触发器、T'触发器,只有在时钟脉冲的上升沿或下降沿时刻,输入信号才能接收。
二、基本触发器:
1、用与非门组成,
(1)两个稳定状态:电路无输入信号即R` =1、S`=1(悬空),0状态(Q=0,Q`=1)和1状态(Q=1,Q`=0)。
(2)R`=1、S`=0,置位,S`是置位端。
& & & & &&R`=0、S`=1,复位,R`是复位端。
(3)翻转时间,即状态变化的反应时间。
(4)有效信号:低电平有效。
& & & & 不允许在R` S`端同时加入0信号;信号同时撤销时状态不定;信号分时撤销时,状态决定于后撤销的信号。
(5)现态、次态、特性表、特性方程,见以下图片。
2、用或非门组成,输入端有效信号:高电平有效
3、集成基本触发器:CMOS集成基本触发器和TTL集成基本触发器。
三、同步触发器:
基本RS触发器缺陷:电路的抗干扰能力下降,不便于多个触发器同步工作。基于这些,改进出了同步触发器。
同步RS触发器和同步D触发器,CP=1期间有效。
其它特性讨论与基本RS触发器类似,可以参考。
四、边沿触发器:
同步触发器缺陷:为了解决同步触发器的时钟电平控制问题,增强电路工作的可靠性,改进出边沿触发器。
边沿触发器:在CP下降沿时刻有效。
其它特性讨论与基本RS触发器类似,可以参考。
五、触发器的电气特性:
1、静态特性
2、动态特性
(1)输入信号的建立时间和保持时间
(2)时钟触发信号的传输延迟时间
六、触发器的VHDL描述和仿真。
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2.1 实验仪器的使用及门电路逻辑功能的测试.doc44页
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2.1 实验仪器的使用及门电路逻辑功能的测试
一、实验目的
熟悉实验仪器和实验箱的使用。
掌握TTL集成电路的使用规则与逻辑功能的测试方法。
二、实验仪器与器件
实验仪器:数字实验箱,万用表。
实验器件:74LS00、74LS02各一片。
三、实验内容 任务1~5
1.示波器的使用
2.数字实验箱的检查
3.测试74LS00(2输入4与非门)的逻辑功能
4.利用门电路控制输出
5.组合电路逻辑功能分析
四、思考题: 1 、 2
五.实验仪器简介
数字实验箱ET-3200B
1.面板设置及使用
电源:±12V、+5V→TTL 。
数据开关SW1~SW4:
置上: 逻辑 “1”(+5V),
置下: 逻辑 “0”(0V)。
单脉冲开关:
拨动一次,插座A输出一个正脉冲,插座输出一个负脉冲。
频率:1HZ、1kHZ、100kHZ,由开关切换。注意市电频率方波为50或60HZ,不要用。
电平指示器
输入逻辑“1”:LED发光,
输入逻辑“0”:LED不发光。
接插实验板
2.注意事项
接地点多处,便于接线。
电源、时钟、数据开关、单脉冲开关输出各自间或相互间不能有短路现
③ 连线拔除时应按住插座,以防插座被带出。
(二)示波器
1.常用开关
√自动扫描 AUTO ――无输入也可显示扫描光迹。一旦有输入信号时,电路自动转为触发扫描状态,调节触发电平得到稳定波形。适于观察50Hz以上的信号。
常态(NORM)――无输入信号时,无光迹。有输入信号时,调节触发电平使电路触发扫描。适于观察50Hz以下的信号。
与波形稳定有关的控制开关
① 触发源:
√CH1通道信号、√CH2通道信号、电源、外接信号4种
双踪显示时适于作触发源的条件是:
周期长者;
时间导前者;
(3)波形边沿陡峭、幅值较
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用VHDL语言设计带有异步置位和复位端的负边沿触发器T触发器。
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用VHDL语言设计带有异步置位和复位端的负边沿触发器T触发器。
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public Form1()
InitializeComponent();
SetStyle(ControlStyles.UserPaint | ControlStyles.ResizeRedraw | ControlStyles.AllPaintingInWmP哗穿糕费蕹渡革杀宫辑aint | ControlStyles.OptimizedDoubleBuffer, true);
这不是VHDL吧
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