什么是一位二进制全减器器？

来源：蜘蛛抓取(WebSpider) 时间：2011-10-25 10:46 标签： 二进制全减器
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VHDL之一位全减器
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31《数字电路》复习题部分答案 一位全减器
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一、填空题 20分1、逻辑分析、逻辑设计的概念2、数字电路的分类、研究方法3逻辑变量和函数只有 两种取值，而且它们只是表示两种不同的逻辑状态。逻辑代数有 ？ 三种基本运算。4、逻辑代数的定理、规则的应用（例：求反函数）5、最小/大项的性质6、由真值表写出函数表达式7、什么是功能模块，小规模中规模设计追求的目标8、中规模器件（编码器，译码器，比较器，选择器，加法器的（1）逻辑功能（2）输入/出的数量关系9、触发器的稳态的互补性，分类，特性方程10、时序电路的组成，特点，分类11、构造一个模N12、代码的转化，例 （ ）8421=（ ）10=（ ）212、PLD常识概念（PLD PLA PAL GAL 及基本结构）二、利用真值表证明函数相等（或函数化简） 10分三、分析题 30分1、分析组合电路2、时序电路 例题四、设计题目 40分1、用门电路设计实现组合电路（15分）2、用3-8译码器（输出低电平有效）/选择器设计实现（10分）①三输入表决电路 ②全加器/全减器③两位数比较器电路 ④优先权判断电路3、时序电路的分析设计（15分）分析设计可满足给定的时序波形图要求的时序电路模拟题一、填空题1、对现成的数字电路，研究它的逻辑功能称为；而 设计它的逻辑电路 称为逻辑设计。2、数字逻辑电路可分为 组合逻辑电路 和 时序逻辑电路 两大类。3、表示逻辑函数的方法有四种 逻辑代数 、 真值表 、卡诺图 和逻辑图，前三者各有特点，适应于不同的场合，它们之间存在内在的联系，可相互转换。4、逻辑变量和函数只有 “0”或“1” 两种取值，而且它们只是表示两种不同的逻辑状态。5、逻辑代数有6、相同变量构成的最小项mi和最大项Mi，应满足 ，。 7、1983=码（1100110）B=8、使用小规模集成电路的逻辑设计，其设计目标追求的是9、采用MSI器件为基础的设计，主要考虑的是要求及价格要求，尽量减少集成器件数 。10、二进制一位全加器是实现 两个一位二进制数进行相加并考虑低位来的进位求得和及向高位进位的 逻辑功能的逻辑电路。11、逻辑函数F?A?B?C?D，其反函数为（A+B）(C+D)。12、若逻辑函数F(A,B,C)=∑m(1,2,4,6) , G(A,B,C)=∑m(0,1,2,3,4,5,7)，则F和G相与的结果13、函数F?AB?AC?BC?CD?D的最简与或式为 时序电路是由组合电路和 存储电路 两部分组成，并形成 反馈回0路 ，它是一种在任何时刻输出不仅取决于该电路的 当前输入 ，而且还与电路的 原来的状态（过去的输入序列）有关的逻辑电路。 14、时序电路按输出特性可分为型和 15、每个触发器可记录位二进制码,因为它有个稳态。16、T触发器特性方程是 Qn+1=T?Qn17、实现三个两位二进制数相乘的组合电路，应有 个输出函数。18、一个二进制编码若需要对12位二进制代码。19、要判断两个二进制数的大小或相等，可用电路实现。20、能从多个输入端中选用一路作为输出的电路是21n22、构造一个模10的同步计数器需要二、列真值表，说明下面F1和F2的关系F1=ABAC F1=AB?AC?BCF2=AB+AC F2= ABC（A+B+C）三、利用卡诺图将下列函数化简为最简的“与或”及“或与”表达式形式。1、F(A,B,C,D)?ABC?ACD?B?C?D2、F（A,B,C,D）=∑m4(0,2,7,13,15)+ ∑d4(1,3,4,5,6,8,10)四、分析电路的逻辑功能。1、分析组合电路的逻辑功能例：2、分析下面的同步时序电路图，要求画出状态转换图及时序波形图。五、分析、设计题1、设计一个三输入的“多数表决电路”，要求用适当的门电路设计最简得逻辑电路。2、设计一个三输入的“优先权判断电路”，要求用适当的门电路设计最简得逻辑电路。3、设计一位二进制数的全加器/全减器。4、设计一个组合逻辑电路，该电路输入端接收两个无符号二进制数A（A=A1A0）和B（B=B1B0），当A=B时，输出F为1，否则F为0。试用合适的逻辑门构造出最简电路。5、试用输出低电平有效的3-8线译码器和逻辑门设计满足下列要求的组合逻辑电路 F1(A,B,C)?A C?ABCF2(A,B,C)?A B?ABCF3(A,B,C)?AC?AB6、设计一个可满足下列波形图要求的时序电路图，其输入为CLK脉冲信号，输出为Z1,Z0。欢迎您转载分享：
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课程实验报告课程名称：数字电路与逻辑设计专业班级：计实1001班学 号：U姓 名：王宸敏 指导教师：唐九飞周 次：第九周 同组人员：熊凯报告日期：日计算机科学与技术学院【内容A】【好文章】一、 实验名称一位全加/全减器的实现二、 实验目的1. 掌握组合逻辑电路的功能测试2. 验证半加器和全加器的逻辑功能3. 学会二进制数的运算规律三、 实验所用仪器和组件1. 二输入四“与非”门1片，型号为74LS002. 三输入三“与非”门1片，型号为74LS103. 二输入四“异或”门1片，型号为74LS86四、 实验设计方案及逻辑图首先根据真值表得到了其卡诺图如下所示：根据输入与输出写出全加/减法器的函数表达式，如下： 实现全加法器的表达式：M?0时，S?A?B?CinCO?AB?ACin?BCin?AB?ACin?BC 实现全减法器的表达式：M?1时，S?A?B?CinCO?AB?ACin?BCin?AB?ACin?BCin.由表达式可知：S采用异或的逻辑门而Co则采用与非的逻辑门得到，因此画出逻辑图如下：五、 实验记录六、 描述实验现象，并运用所学的知识进行分析、处理及讨论1. 在m=0时，在输入端输入三个电平时，输出实现了全加器的功能，即把三个输入当作被加数、加数和低位的进位，同时两个输出分别表示了和与低位的进位。 2. 在m=1时，在输入端输入三个电平时，输出实现了全减器的功能，即把三个输入当作被减数、减数和低位的借位，同时两个输出分别表示了差与高位的借位。 因为电路的设计是根据真值表的结果得到的，通过真【】值表画出卡诺图从而的到输出关于输入的表达式，因此他所实现的功能正是我们所需要的全加器与全减器的功能，只不过是通过逻辑门进行了处理，得到的是正确的值。【内容C】一、 实验名称舍入与检测电路的设计二、 实验目的1. 掌握组合逻辑电路的功能测试2. 验证 半加器和全加器的逻辑功能3. 学会二进制数的运算规律三、 实验所用仪器和组件1. 六门反向器组件1片，型号为74LS042. 二输入四“与非”门组件1片，型号为74LS003. 三输入三“与非”门组件1片，型号为74LS104. 二输入四“异或”门组件1片，型号为74LS86四、 实验设计方案及逻辑图 根据题意，输入为8421码,F1表示“四舍五入”电路的输出，其卡诺图如下：由卡诺图可得到其函数表达式，并且经过化简如下：F1?B8?B4B2?B4B1?B8?B4B2?B4B1因此，根据表达式可以设计电路图如下所示：同理，可以容易分析得到卡诺图如下：输出F2的表达式，如下：F2?B8?B4?B2?B1由表达式，得到逻辑电路如下：五、 实验记录六、 描述实验现象，并运用所学的知识进行分析、处理及讨论1.对于“四舍五入”电路，当输入的8421码小于等于4时，即，，0100这五种状态，显示灯不亮，表示输出为0；当输入的8421码大于等于5时，即，，1001这五种状态，显示灯亮，表示输出2.为1.对于输入的1的个数的电路，当输入的1的个数为奇数时，即，0100，这五种状态，显示灯亮，表示输出为1；当输入的1的个数为偶数时，即，，1001这五种状态，显示灯不亮，表示输出为0.当四个输出进入所对应的逻辑门电路后，根据之前的真值表、卡诺图及表达式，得到了正确的输出状态，在这里逻辑门电路就是让输入完成得到正确的输出结果。七、 回答思考题1. 化简包含无关条件的逻辑函数时应该注意什么？答：有无关条件的逻辑函数时，应先作出其卡诺图，根据表达式最简的这一要求将无关条件任意的置0或置1，总之，是要把表达式化作最简。2. 多输出逻辑函数化简时应注意什么？答：多输出的逻辑函数化简时，应分别针对某一输出化简得到关于输入的最简表达式。3. 你所设计的电路是否达到了最简？为什么？答：显然达到了最简。我设计的电路的最简表达式是根据卡诺图得 到了，因为再找卡诺图的必要最小质蕴含项时是正确的，因此得到的表达式是最简的，从而设计的逻辑电路也是最简的。
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